# 车库Z2芯片光刻制备：掩模对准仪构建、光刻胶涂布/显影与等离子刻蚀

> Sam Zeloof车库Z2项目详解maskless aligner自制、PR涂布/显影参数、RIE刻蚀要点，实现10μm NMOS晶体管集成。

## 元数据
- 路径: /posts/2025/12/07/garage-z2-lithography-mask-aligner-photoresist-etching/
- 发布时间: 2025-12-07T12:46:49+08:00
- 分类: [systems-engineering](/categories/systems-engineering/)
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## 正文
车库级集成电路制造看似遥不可及，但Sam Zeloof的Z2芯片证明，通过自制设备与精细参数控制，即可实现晶体管级光刻工艺。该项目聚焦mask aligner构建、光刻胶(photoresist, PR)涂布/显影及等离子刻蚀(plasma etching)，产出1200个10μm多晶硅栅NMOS晶体管阵列，阈值电压(Vt)仅1.1V，泄漏电流932pA(Vds=2.5V)，on/off比4.3e6，性能媲美1971年Intel 4004工艺[1]。

### 自制Mask Aligner：DLP无掩模投影光刻仪
传统mask aligner依赖昂贵汞灯与精密对准，Zeloof采用maskless方案：基于DLP投影仪(Digital Light Processing)的Mark IV stepper。核心组件包括二手Nikon显微镜、自定义光学镜头组(聚焦365nm UV光源，衍射极限分辨率<250nm)、LabView控制的XYZ平移台与真空卡盘，支持2英寸(50mm)晶圆自动步进曝光。

构建要点：
- **光源**：UV LED阵列或汞灯，强度~80mW/cm²@365nm，确保厚PR均匀曝光。
- **投影系统**：DLP芯片投射PS设计的16:9掩模图案，缩放至晶圆尺寸，曝光场~蓝点直径，手动/自动步进(每场9s)。
- **对准**：计算机视觉+参考标记，精度<3μm；真空卡盘固定晶圆，避免振动。
- **参数**：曝光剂量视PR厚度，Z2用~140-210mJ/cm²；步进间隙<100μm，观察掩模反射判断距离。

此设计成本<7500美元，体积紧凑(无需洁净室)，支持多层对准，Z2用4掩模(活跃区、栅极、接触、金属)，对准误差控制在1μm内，避免寄生电容。该aligner是车库fab核心，扩展至sub-μm需升级18bit DAC与beam blanker。

### 光刻胶涂布与显影：旋涂参数优化
PR涂布是光刻起点，Zeloof选AZ MiR 701(薄氧化物图案，1.5μm)与AZ 4210(Al层，3.5μm)，正性胶，便宜易得(冷藏保存，避免变质)。

涂布清单：
1. **预处理**：脱水烘烤(至700°C恢复疏水面)，HMDS蒸气底漆(200°C，单分子层增强粘附)。
2. **旋涂**：3000-4000rpm，30s，100μL胶液；厚度1-3.5μm。
3. **软烘**：90-95°C热板，1min，去溶剂。
4. **曝光**：aligner步进，剂量依厚度(厚胶需更高)。
5. **显影**：2% KOH或TMAH，1min；超声辅助均匀。
6. **硬烘**：145°C近软化点，30min，提升抗蚀性(BOE/HF耐受)。

Z2 PR用于活跃区图案(定义S/D井)、栅极刻蚀(poly-Si)、接触窗(Oxide etch)。硬烘PR作场介质(250°C，1μm厚)，替代CVD SiO2。显微镜检查图案，若漂胶则增HMDS/厚度。丙酮超声剥胶，残留用O2 RIE+Piranha。

### 等离子刻蚀与晶体管集成：RIE参数落地
Z2“gate-first”工艺避场氧化，用预存poly-Si晶圆(10nm gate ox +300nm poly)，焦点plasma etching定义栅极/接触。Zeloof自制RIE(反应离子刻蚀)，气体CF4/CHF3(Oxide)、SF6(poly-Si)、HNO3湿备选。

刻蚀参数：
- **SiO2接触窗**：1% HF或RIE(CF4/CHF3，50-100mTorr，偏压控制各向异性)，蚀刻率~20min/6000Å(20°C BOE：NH4F 20-30g/50mL HF +Triton X-100)。
- **Poly-Si栅**：SF6 RIE或HNO3湿蚀，~300nm厚，自对准S/D扩散(>1000°C管式炉，P509掺杂45min)。
- **金属**：热磷酸(50°C)，Al 1μm蒸镀后图案。

集成流程：
1. 图案活跃区，蚀poly暴露ox，磷扩散S/D。
2. 蚀栅定义channel。
3. 沉积硬烘PR介质，蚀接触。
4. Al蒸镀/溅射，湿蚀互连。

监控：profilometer测栅厚(Å级)，SEM横截(尘粒定位短路)，HP4145A IV曲线(Vth=1.1V，Cgs<0.9pF)。良率~8%(1/12完美，常见S/D短路bulk尘污染)。

风险与回滚：
- **尘污染**：无洁净室，阈值>1μm颗粒致短路；监控：HEPA预滤+ glovebox，回滚弃批重做。
- **对准漂移**：<3μm阈值超标重曝光；自动化视觉对准。
- **安全**：HF/RIE气体，通风+中和；高温炉>1000°C，Inconel部件避污染。
- **变异**：Vt波动±0.5V，统计10x阵列优化扩散时间。

Z2验证车库fab潜力：15芯片1500 transistors，至少3功能(1完美，2~80%)，超Z1 200倍。扩展CMOS需poly沉积(激光退火非晶Si)。

**资料来源**：
[1] Sam Zeloof, Z2 IC: \"The Z2 has 100 transistors on a 10µm polysilicon gate process.\" https://sam.zeloof.xyz/second-ic/
[2] Zeloof Blog, Chemicals/Etch: \"HF (1%) or CF4/CHF3 RIE; HNO3 for poly etch or SF6 RIE.\" https://sam.zeloof.xyz/

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